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    門控時鐘-實際研究
    門控時鐘-實際研究
    發布時間 : 2014-04-20 15:18:00
    門控時鐘-實際研究2010年7月3日4bit帶使能計數器,包括正沿觸發與負沿觸發;1.功能仿真:1.電路結構與仿真波形:2.插入帶latch的ICG(集成門控):1.綜合腳本:2.門控綜合結果:3.仿真波形:3.插入不帶latch的ICG:1.綜合腳本:1.需要查找庫中是否存在不帶Latch的ICG;2.需要分別選擇上升沿觸發寄存器和下降沿觸發寄存器的對應門控單元;3.腳本:2.綜合結果:3.仿真時序圖:4.注意點:1.只有上升沿輸出的使能(這個使能只要是通一個時鐘輸出的上升沿信號組合出來的都可以)控制上升沿促發的寄存器才可以插入上升沿類型的ICG;2.只有下降沿輸出的使能(這個使能只要是通一個時鐘輸出的上升沿信號組合出來的都可以)控制下降沿促發的寄存器才可以插入下降沿類型的ICG;3.如果要使用上升沿組合成的使能來門控下降沿的門控或反之,則需要手工例化ICG,或寫門控邏輯來門控。4.如果在綜合腳本改成下面的腳本,綜合會保持,結果會插入帶latch結構的ICG;4.插入帶latch的分立門控:1.門控綜合腳本:2.門控綜合結果:3.仿真波形:5.插入不帶latch的分立門控:1.綜合腳
    門控時鐘-實際研究2010年7月3日4bit帶使能計數器,包括正沿觸發與負沿觸發;1.功能仿真:1.電路結構與仿真波形:2.插入帶latch的ICG(集成門控):1.綜合腳本:2.門控綜合結果:3.仿真波形:3.插入不帶latch的ICG:1.綜合腳本:1.需要查找庫中是否存在不帶Latch的ICG;2.需要分別選擇上升沿觸發寄存器和下降沿觸發寄存器的對應門控單元;3.腳本:2.綜合結果:3.仿真時序圖:4.注意點:1.只有上升沿輸出的使能(這個使能只要是通一個時鐘輸出的上升沿信號組合出來的都可以)控制上升沿促發的寄存器才可以插入上升沿類型的ICG;2.只有下降沿輸出的使能(這個使能只要是通一個時鐘輸出的上升沿信號組合出來的都可以)控制下降沿促發的寄存器才可以插入下降沿類型的ICG;3.如果要使用上升沿組合成的使能來門控下降沿的門控或反之,則需要手工例化ICG,或寫門控邏輯來門控。4.如果在綜合腳本改成下面的腳本,綜合會保持,結果會插入帶latch結構的ICG;4.插入帶latch的分立門控:1.門控綜合腳本:2.門控綜合結果:3.仿真波形:5.插入不帶latch的分立門控:1.綜合腳
    如何保證驗證的質量-修訂稿
    如何保證驗證的質量-修訂稿
    發布時間 : 2014-04-20 15:10:00
    2010年2月28日驗證是設計質量的保證方式,沒有一個設計不經過驗證就可以準確運行的。所以驗證本身該如何保證質量就顯得非常重要了。整個驗證工作在形式上主要表現為兩方面:1,驗證點;2,驗證環境(包括測例)驗證環境是驗證點的載體,是驗證點的具體實現。對項目而言,還包括驗證的組織工作,驗證的組織者是否合格將決定真個項目的驗證工作是否能夠順利開展。對驗證點而言,它的重點是完備性;對驗證環境而言,它的重點
    2010年2月28日驗證是設計質量的保證方式,沒有一個設計不經過驗證就可以準確運行的。所以驗證本身該如何保證質量就顯得非常重要了。整個驗證工作在形式上主要表現為兩方面:1,驗證點;2,驗證環境(包括測例)驗證環境是驗證點的載體,是驗證點的具體實現。對項目而言,還包括驗證的組織工作,驗證的組織者是否合格將決定真個項目的驗證工作是否能夠順利開展。對驗證點而言,它的重點是完備性;對驗證環境而言,它的重點
    利用庫中信息手算功耗
    利用庫中信息手算功耗
    發布時間 : 2014-04-20 01:59:00
    比較兩種電路的功耗,一種常用的做法是STA跑出sdf文件,vcs跑出后仿波形,再分別用primepower工具進行功耗分析。對于簡單的門級電路,這樣的流程顯得復雜低效,這時手算功耗可能會更加有用。
    比較兩種電路的功耗,一種常用的做法是STA跑出sdf文件,vcs跑出后仿波形,再分別用primepower工具進行功耗分析。對于簡單的門級電路,這樣的流程顯得復雜低效,這時手算功耗可能會更加有用。
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